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FPGA開發(fā)工程師求職簡歷

求職意向

● 求職類型: 全職

● 意向崗位: IC驗證工程師

● 意向城市: 廣東廣州

● 薪資要求: 面議

● 求職狀態(tài): 隨時到崗

教育背景

20xx.9-20xx.6

錘子簡歷大學 | 通信與信息系統(tǒng)

● 電子科大二等獎學金

● 計算機四級網(wǎng)絡工程師

● GPA專業(yè)前10%

● 助理工程師職稱

● 中共黨員

工作經歷

廣州某科技有限公司 | IC驗證工程師

20xx.12-至今

DPU玄靈項目/銀杉V2項目

CBS engine模塊驗證

● 項目描述: CBS模塊負責host中blk報文處理，在host(virtio_blk)和soc(spdk)間進行內存搬移操作。

● 職責:

1. 基于spec提取驗證計劃(Vplan)

2. 搭建基于UVM框架的CBS BT驗證環(huán)境

3. 編寫測試用例，利用SVA、功能覆蓋率完善平臺監(jiān)控

4. 回歸用例，完成100%代碼覆蓋率檢查(check_list)

INFRA子系統(tǒng)驗證

● 項目描述: INFRA模塊連接外部接口，實現(xiàn)host/soc/bond間數(shù)據(jù)交換轉發(fā)，包含desc_buffer、eng-grp、noc等子模塊。

● 職責: 根據(jù)spec完善Vplan

VRDMA項目

● 項目描述: 騰訊自研高性能網(wǎng)絡協(xié)議，HARP Engine實現(xiàn)機頭到Cell側IO數(shù)據(jù)搬移。

NOC_IQ/DMI/FDMA驗證

● 項目描述: 數(shù)據(jù)路徑關鍵模塊驗證（內容略）

公共業(yè)務

1. 開發(fā)`ral_reg_extract.py`工具：支持ASIC/FPGA模式，自動化生成reg_model

2. 開發(fā)中斷/EEC/Parity檢測組件（已申請專利）

3. 重構`tgen_env`工具：模塊化UVM驗證平臺生成

廣州某科技有限公司 | IC驗證工程師

20xx.3-20xx.12

5nm網(wǎng)絡處理器項目（TM子系統(tǒng)QoS模塊）

● 項目描述: 流量管理子系統(tǒng)實現(xiàn)報文緩存/隊列/擁塞管理。

● 職責:

○ 編寫模塊設計文檔與驗證計劃

○ 搭建UVM/Palladium Z1加速器驗證平臺

○ 完成54個功能點驗證，開發(fā)Perl輔助工具

● 成果: 實現(xiàn)100%可解釋覆蓋率

14nm智能網(wǎng)關項目（TM子系統(tǒng)SOPC模塊）

● 職責:

○ 增加保序對比與丟包重傳機制

○ 完成20個功能點驗證

廣州某科技有限公司 | FPGA開發(fā)工程師/驗證工程師

20xx.7-20xx.2

THz被動式成像系統(tǒng)研發(fā)

● 職責:

○ 64通道數(shù)據(jù)板卡設計（ZYNQ-7000平臺）

○ ADC/DAC驅動開發(fā)，Linux嵌入式系統(tǒng)搭建

● 成果: 實現(xiàn)10fs成像速率，1500人/小時安檢效率

自我評價

1. 精通SystemVerilog/UVM驗證方法學

2. 熟練使用SVA/OVL/Formal驗證手段

3. 掌握Python/Perl腳本開發(fā)

4. 熟練操作VCS/Verdi/Palladium Z1等EDA工具

5. 熟悉ZYNQ-7000/Xilinx/Altera開發(fā)平臺

6. 精通數(shù)字電路/SPI/IIC/AXI4等協(xié)議

> 注：簡歷模板已按Markdown格式優(yōu)化，包含分級標題、項目符號、代碼塊標記等標準語法，可直接用于GitHub/Latex等平臺渲染。關鍵技術術語（如UVM、SVA等）保留英文縮寫以符合行業(yè)慣例。

文/錘子簡歷

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